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D 型触发器

SN74LVC2G74

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具有清零和预设功能的单路正边沿 D 类触发器

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产品详情

Number of channels 1 Technology family LVC Supply voltage (min) (V) 1.65 Supply voltage (max) (V) 5.5 Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 200 IOL (max) (mA) 32 IOH (max) (mA) -32 Supply current (max) (µA) 10 Features Balanced outputs, Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Operating temperature range (°C) -40 to 125 Rating Catalog
Number of channels 1 Technology family LVC Supply voltage (min) (V) 1.65 Supply voltage (max) (V) 5.5 Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 200 IOL (max) (mA) 32 IOH (max) (mA) -32 Supply current (max) (µA) 10 Features Balanced outputs, Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Operating temperature range (°C) -40 to 125 Rating Catalog
DSBGA (YZP) 8 2.8125 mm² 2.25 x 1.25 SSOP (DCT) 8 11.8 mm² 2.95 x 4 VSSOP (DCU) 8 6.2 mm² 2 x 3.1
  • 采用德州仪器 (TI) NanoFree™ 封装
  • 支持 5V VCC 运行
  • 输入电压高达 5.5V
  • 3.3V 时 tpd 最大值为 5.9ns
  • 低功耗，ICC 最大值为 10µA
  • 3.3V 时的输出驱动为 ±24mA
  • VOLP（输出接地反弹）典型值 小于 0.8V（VCC = 3.3V、TA = 25°C 时）
  • VOHV（输出 VOH 下冲）典型值 大于 2V（VCC = 3.3V、TA = 25°C 时）
  • Ioff 支持带电插入、局部关断模式和后驱动保护
  • 闩锁性能超过 100mA，符合 JESD 78 II 类规范的要求
  • ESD 保护性能超过 JESD 22 规范要求
    • 2000V 人体放电模型
    • 200V 机器放电模型
    • 1000V 充电器件模型
  • 采用德州仪器 (TI) NanoFree™ 封装
  • 支持 5V VCC 运行
  • 输入电压高达 5.5V
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  • 低功耗，ICC 最大值为 10µA
  • 3.3V 时的输出驱动为 ±24mA
  • VOLP（输出接地反弹）典型值 小于 0.8V（VCC = 3.3V、TA = 25°C 时）
  • VOHV（输出 VOH 下冲）典型值 大于 2V（VCC = 3.3V、TA = 25°C 时）
  • Ioff 支持带电插入、局部关断模式和后驱动保护
  • 闩锁性能超过 100mA，符合 JESD 78 II 类规范的要求
  • ESD 保护性能超过 JESD 22 规范要求
    • 2000V 人体放电模型
    • 200V 机器放电模型
    • 1000V 充电器件模型

这款单路上升沿触发 D 类触发器需在 1.65V 至 5.5V VCC 下运行。

NanoFree™ 封装技术是 IC 封装概念的一项重大突破，它将硅晶片用作封装。

预设 (PRE) 或清零 (CLR) 输入端的低电平将会设置或重置输出，而不受其他输入端的电平的影响。当 PRE 和 CLR 处于非活动状态（高电平）时，数据 (D) 输入处满足设置时间要求的数据将传输到时钟脉冲正向缘上的输出处。时钟触发在一定电压电平下发生，与时钟脉冲的上升时间没有直接关系。经过保持时间间隔后，可以更改 D 输入端的数据而不影响输出端的电平。

该器件完全符合使用 Ioff 的部分断电应用的规范要求。Ioff 电路禁用输出，从而可防止其断电时破坏性电流从该器件回流。

这款单路上升沿触发 D 类触发器需在 1.65V 至 5.5V VCC 下运行。

NanoFree™ 封装技术是 IC 封装概念的一项重大突破，它将硅晶片用作封装。

预设 (PRE) 或清零 (CLR) 输入端的低电平将会设置或重置输出，而不受其他输入端的电平的影响。当 PRE 和 CLR 处于非活动状态（高电平）时，数据 (D) 输入处满足设置时间要求的数据将传输到时钟脉冲正向缘上的输出处。时钟触发在一定电压电平下发生，与时钟脉冲的上升时间没有直接关系。经过保持时间间隔后，可以更改 D 输入端的数据而不影响输出端的电平。

该器件完全符合使用 Ioff 的部分断电应用的规范要求。Ioff 电路禁用输出，从而可防止其断电时破坏性电流从该器件回流。
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应用手册 CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
应用手册 LVC Characterization Information 1996年 12月 1日
应用手册 Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
应用手册 Live Insertion 1996年 10月 1日
设计指南 Low-Voltage Logic (LVC) Designer's Guide 1996年 9月 1日
应用手册 Understanding Advanced Bus-Interface Products Design Guide 1996年 5月 1日

设计和开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

5-8-LOGIC-EVM — 支持 5 至 8 引脚 DCK、DCT、DCU、DRL 和 DBV 封装的通用逻辑评估模块

灵活的 EVM 设计用于支持具有 5 至 8 引脚数且采用 DCK、DCT、DCU、DRL 或 DBV 封装的任何器件。
用户指南: PDF
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仿真模型

HSPICE MODEL OF SN74LVC2G74

SCEJ238.ZIP (91 KB) - HSpice Model
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仿真模型

SN74LVC2G74 IBIS Model

SCEM282.ZIP (51 KB) - IBIS Model
下载
参考设计

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设计指南: PDF
原理图: PDF
封装 引脚 CAD 符号、封装和 3D 模型
DSBGA (YZP) 8 Ultra Librarian
SSOP (DCT) 8 Ultra Librarian
VSSOP (DCU) 8 Ultra Librarian
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  • 材料成分
  • 鉴定摘要
  • 持续可靠性监测
包含信息：
  • 制造厂地点
  • 封装厂地点

支持和培训

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