软件
IDE、配置、编译器或调试器
此系统级设计展示了如何使用 Xilinx VC707 平台一起同步两个 ADC12J4000 评估模块 (EVM)。此设计文档介绍了必要的硬件修改和器件配置,包括时钟方案。此设计显示了每个 EVM 的示例配置文件。此设计介绍了 FPGA 固件,并显示相关的 Xilinx IP 块配置参数。此外还显示并分析了在实际硬件上采集的数据,测试结果显示出 50ps 内的同步,未使用特性化电缆,也未校准传播延迟。
我们开发的全面组装电路板仅用于测试和性能验证,不可用于销售。
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在设计中包括 TI 产品和可能的替代产品。
类型 | 标题 | 下载最新的英文版本 | 日期 | |||
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设计指南 | Synchronization of JESD204B Giga-Sample ADCs | 2015年 1月 20日 |