TLC555
- 极低功耗:
- VDD = 5V 时为 1mW(典型值)
- 能够在非稳态模式下正常工作
- 支持轨到轨摆动的 CMOS 输出
- 高输出电流能力
- 灌电流:100mA(典型值)
- 拉电流:10mA(典型值)
- 输出与 CMOS、TTL 和 MOS 完全兼容
- 低电源电流在输出转换期间降低了尖峰
- 2V 至 15V 单电源运行
- 在功能上可与 NE555 互换;具有相同的引脚
- ESD 保护超出 ANSI/ESDA/JEDEC JS-001 规定的 1000V
- 可用于 Q 级温度汽车
- 高可靠性汽车应用
- 配置控制和打印支持
- 通过汽车标准鉴定
TLC555 是一款采用 TI LinCMOS™ 技术制造的单片定时电路。该计时器与 CMOS、TTL 和 MOS 逻辑器件完全兼容,可在最高 2MHz 的频率下运行。由于输入阻抗较高,此器件可支持比 NE555 或 LM555 所支持的计时电容器更小的计时电容器。因此,可实现更加准确的延时时间和振荡。在整个电源电压范围内可保持较低功耗。
与 NE555 类似,TLC555 有一个约等于电源电压三分之一的触发电平以及一个约等于电源电压三分之二的阈值电平。可使用控制电压端子 (CONT) 来改变这些电平。当触发输入 (TRIG) 下降至低于触发电平的时候,触发器被设定并且输出变为高电平。如果 TRIG 高于触发电平并且阈值输入 (THRES) 在阈值电平之上的话,触发器被复位并且输出为低电平。复位输入 (RESET) 的优先级高于所有其它输入并且可被用来启动一个新的定时周期。如果 RESET 为低电平,触发器被复位并且输出为低电平。只要当输出为低电平,在放电端子 (DISCH) 和接地 (GND) 之间提供一个低阻抗路径。所有未用输入端必须接入合适的逻辑电平以免发生误触发。
技术文档
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查看全部 6 类型 | 标题 | 下载最新的英语版本 | 日期 | |||
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* | 数据表 | TLC555 LinCMOS™ 技术计时器 数据表 (Rev. J) | PDF | HTML | 英语版 (Rev.J) | PDF | HTML | 2023年 12月 12日 |
电路设计 | Frequency-to-Voltage Conversion Circuit Using a 555 Timer | 2023年 9月 21日 | ||||
应用手册 | Considering TI Smart DACs As an Alternative to 555 Timers | PDF | HTML | 2021年 9月 2日 | |||
更多文献资料 | Design low-duty-cycle timer circuits | 2016年 10月 3日 | ||||
应用手册 | TLC555-Q1 Used as a Positive and Negative Charge Pump | 2016年 5月 25日 | ||||
应用手册 | Synchronizing Three or More UCC28950 Phase-Shifted, Full-Bridge Controllers | 2011年 9月 13日 |
设计和开发
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仿真模型
TLC555 TINA-TI Astable Reference Design (Rev. B)
SLFM002B.TSC (100 KB) - TINA-TI Reference Design
计算工具
This spreadsheet calculates the complete design of a TLC555 timer-based astable circuit given the timing capacitance, on time, and desired duty cycle. Resistor values are calculated to the nearest 1% value.
模拟工具
PSPICE-FOR-TI — 适用于 TI 设计和模拟工具的 PSpice®
PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用,包括业内超大的模型库之一,涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。
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参考设计
TIDA-010085 — 使用数字隔离器的 24VAC 多通道固态继电器参考设计
此参考设计演示了使用单隔离的多通道固态继电器 (SSR)。该设计使用带有单隔离电源的多通道数字隔离器,以及使用公共接地栅极驱动电路来单独控制多个 SSR。该设计适用于额定电流高达 2A 的 24VAC 供电继电器,但可扩展至 240VAC 和更高的额定电流。每个 SSR 通道使用小于 75mm2 的空间,元件的最大高度约为 3mm,与机电继电器相比,可大大节省空间。使用单隔离电源可节省布板空间和 BOM 成本。
封装 | 引脚 | CAD 符号、封装和 3D 模型 |
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PDIP (P) | 8 | Ultra Librarian |
SOIC (D) | 8 | Ultra Librarian |
SOP (PS) | 8 | Ultra Librarian |
TSSOP (PW) | 14 | Ultra Librarian |
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